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Junior FPGA Designer ELT Group - Rocca Santo Stefano, Lazio, it procedures and deadlines Responsible for Hardware and Firmware requirements analysis, design, test, integration and validation activities Design methodologies based on the reuse of Intellectual Properties (IPs 14 giorni fa
Validation Assurance Technician Adecco - Anagni, Frosinone - Stesura di Validation Plan / Validation Master Plan relativi all’introduzione di nuovi prodotti, nuovi impianti/sistemi/macchine. - Stesura/revisione documentazione di Risk Assessment 12 giorni fa

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